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公益培訓(xùn)

曙海動(dòng)態(tài)

1. 數(shù)字信號(hào)處理基本概念
   1.1 信號(hào)的表示與數(shù)字化
   1.2 數(shù)的表示
   1.3 采樣原理
   1.4 傅里葉變換
   1.5 濾波器
   【AD接口專(zhuān)題：AD與FPGA接口】
2. 數(shù)字信號(hào)處理解決方案及設(shè)計(jì)流程
   2.1 傳統(tǒng)的DSP處理器解決方案
   2.2 基于FPGA的解決方案
   2.3 基于FPGA+DSP解決方案
   【DSP接口專(zhuān)題：TI DSP與FPGA接口】
   【高速互聯(lián)專(zhuān)題：FPGA中的SERDES】
   【C to HDL專(zhuān)題：ImpulseC解決方案】
3. 常用數(shù)字信號(hào)處理模塊的FPGA實(shí)現(xiàn)
   3.1 加減乘除的FPGA實(shí)現(xiàn)
   3.2 DDS的FPGA實(shí)現(xiàn)
   3.3 FFT的FPGA實(shí)現(xiàn)
   3.4 Cordic的FPGA實(shí)現(xiàn)
   3.5 濾波器的FPGA實(shí)現(xiàn)

【實(shí)驗(yàn)】
1. Matlab與Simulink工具箱使用實(shí)踐
   1.1 Matlab基礎(chǔ)
   1.2 M文件：腳本與函數(shù)
   1.3 Simulink基礎(chǔ)
   1.4 Simulink建模
2. [Altera]/[Xilinx]中典型數(shù)字信號(hào)處理IP使用實(shí)踐
   2.1 濾波器IP核：FIR
   2.2 變換IP核：FFT
   2.3 調(diào)制IP核：DDS
   2.4 編碼IP核：CORDIC，8b/10b
   2.5 糾錯(cuò)IP核：Viterbi

在第二階段，重點(diǎn)介紹[Altera DSP Builder]/[Xilinx System Generator]的相關(guān)內(nèi)容，包括設(shè)計(jì)流程、常用IP模塊介紹及使用方法，在Simulink中搭建層次化的算法結(jié)構(gòu)。講解利用ModelSim進(jìn)行協(xié)同仿真的方法，利用[SignalTap] /[ChipScope]進(jìn)行軟硬件協(xié)調(diào)測(cè)試手段。

1. [Altera]/[Xilinx]的DSP解決方案及設(shè)計(jì)流程
2. [Altera]/[Xilinx]FPGA的DSP資源
3. [DSP Builder]/[System Generator]常用IP核
4. [DSP Builder]/[System Generator]仿真
5. [DSP Builder]/[System Generator]的軟硬件協(xié)調(diào)測(cè)試
   【通信中的數(shù)字信號(hào)處理專(zhuān)題】
   【多媒體信號(hào)處理專(zhuān)題】

【實(shí)驗(yàn)】
1. [DSP Builder]/[System Generator]工具箱使用方法
   1.1 構(gòu)建第一個(gè)[DSP Builder]/[System Generator]系統(tǒng)
   1.2 層次化設(shè)計(jì)及系統(tǒng)構(gòu)建方法
   1.3 常用IP模塊及設(shè)計(jì)要點(diǎn)
2. 仿真及調(diào)試實(shí)踐
   2.1 DDS信號(hào)源設(shè)計(jì)與Modelsim仿真
   2.2 [SignalTap]/[ChipScope]調(diào)試實(shí)踐
   2.3 [DSP Builder 與Quartus II]/[System Generator與ISE]的接口
   【Accel DSP專(zhuān)題】開(kāi)發(fā)流程、工具鏈、操作實(shí)踐